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ASIC Design/ Verification 面试经验总结

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lwy1992417 发表于 2015-4-22 23:39:01 | 显示全部楼层 |阅读模式

2015(1-3月) 电路/电子/半导体类 硕士 全职@APPLE, NVIDIA, QUALCOMM, CADENCE, ORACLE, MENTOR GRAPHICS... - Other - 技术电面 Onsite 校园招聘会 |Passfresh grad应届毕业生

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找工作终于告一段落,非常感谢地里前辈的信息,现在我也来分享一下我的面试经验,希望对大家有一点点帮助。不对的地方请大家指正。排版比较烂而且中英文混着打标点也比较乱,大家见谅。:)
我找工作的方向是ASIC Verification, 除了一个公司面试的是ASIC Design之外,其他的公司都是Verificaiton 的岗位。个人觉得对于这个方向,需要准备的主要有以下方面:  1)RTL design : Gate-level design and Verilog coding.
  2)Verification methodology : constrained-random methodology and SystemVerilog.
  3)Computer architecture: Cache (implementation, policies, coherence protocol); CPU pipeline (ROB, OOO, exception handling, renaming); Branch predictor (Speculation);                                               Memory hazard; Hazards (Control; data; structure).. 鍥磋鎴戜滑@1point 3 acres
  4) Low power techniques: Multi-Vth; Clock gating; Multi-VDD (Power gating); Dynamic Frequency Voltage Scaling (cross frequency domain issues).. 鐗涗汉浜戦泦,涓浜╀笁鍒嗗湴
  5) Coding: Perl/Python (regular expression); C++; SV; Verilog; Unix.
  6) Tool: Simulation tool (Modelsim); Sythesis tool (Synopsys DC); Schematic and layout tool (Cadence Virtuoso).

以下是按公司分的面试经验,这里公司名字我就用首字母代替了。
N公司:他家的特点是用 C++ Verification。所以不管是onsite还是电面都是coding.           C++; SystemVerilog (pass by reference); Scripting language (regular expression); design(sequence detector).
. From 1point 3acres bbs
A公司:他家的难度在一票否决制度,8个人onsite得都满意才能给offer。面了他家三个组,我就分开列出来吧。
            Cupertino CPU team: Computer architecture (MOESI); C; Verification methodology.
            Cupertino SOC team: Constrained random verification methodology; Different behaviors of instruction & data cache miss between in-order five-stagepipeline and                                                         OOO Tomasulo’s pipeline; Cross timing domain.            Austin GPU team:Q公司:Polymorphism; Cache implementation; Verification methodology.
            Onsite Cupertino: Cache coherence protocol; Speculation to handle control depdendency, what if the prediction is wrong; C++ debugging; Polymorphism; Perl scripting;                                       DV methodology; Low power techniques (isolation cell); Cross frequency domain; Load/store and supporting structure; FIFO design and coding;  Basic                                       design question ( use MUX to build XOR).

Q公司:已经onsite完1个多月还在让我等分组,说是总部不给钱发不了offer. 总的来说就是不靠谱,对于他家我只想说,没职位就别出来招人,浪费所有人时间。
            Phone interview: Branch predictor; latch vs register; LRU vs LFU; data hazard in different types of CPU pipelines; 8 entry table design.. from: 1point3acres.com/bbs
            Onsite: Memory verification; Perl scripting; Coverage-driven constrained-random verification methodology; adder design and some advanced related question; Branch                            predictor; Lower power techniques; Virtual address mapping; Aseries of assembly code to figure out hazard; Verilog coding of returning available entry of 8-                              entry resource.


M公司:一家做tool的公司。
           Phone interview: coverage-driven assertion-based contrained-random verification methodology; resume related.
           Onsite: declined since schedule conflicted with other onsite.


. more info on 1point3acres.comO公司:
          Phone interview: Focused on the verification project I've done; Basic design question and optimization methods.. 鍥磋鎴戜滑@1point 3 acres
          Onsite: Very broad in scope and more focus on the field they're working on instead of the qulificaiton of the role; Firmware; Design verification; Synthesis; Area                                   optimization; Latency optimization; Low power techniques; Co-simulation; Many practical questions related to RTL design and the intrinsic mechanism of synthesis                     tool (synopsys design compiler).. visit 1point3acres.com for more.

. From 1point 3acres bbs
C1公司:这家公司的特色就是执着于DSP.
            Phone interview: 8-bit counter design; Verify a 2-bit counter; Cross clock domain issues and solutions; Assertions; Design basics (timing constraints)-google 1point3acres

C2公司:他家也是做tool的,职位是Design.个人觉得面的非常难,因为全是principal engineer和director。
            Phone interview: 4 ways to build a MUX in Verilog; Blocking vs non-blocking; Sequential vs combinational; Coverage-driven constrained-random verification                                                       methodology; FSM; Sythesis; Low power; Cross clock domain; Synthesis.
            Onsite: Cross clock domain FIFO design; Handshake circuit design to handle unreliable data transfer; Physical design; Place and route; Low power techniques; A                                   tough sequence detector (4-bit input instead of simple one bit) with some corner cases; Given a timing diagram of a system and asked to verify the behaviours;                          SystemVerilog Assertions.. visit 1point3acres.com for more.


. more info on 1point3acres.com

. visit 1point3acres.com for more.




补充内容 (2015-4-22 23:46):
发帖后排版居然变成这样。。。 请问发帖了之后如何编辑?

评分

5

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halfbloon 发表于 2015-4-23 00:39:11 | 显示全部楼层
支持楼主,在这么多硬转软的大环境下能坚持,还发面经,感谢!支持!
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xming0819 发表于 2015-4-23 03:00:43 | 显示全部楼层
C1公司 C2公司 一个是cadence另一个是?
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andyhe829 发表于 2015-4-23 03:06:19 | 显示全部楼层
请问mentor graphics楼主面的是什么地方的分部呢?为什么在官网和LinkedIn上看他们都没有什么技术岗位放出呀?
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 楼主| lwy1992417 发表于 2015-4-23 08:31:27 | 显示全部楼层
halfbloon 发表于 2015-4-23 00:39
支持楼主,在这么多硬转软的大环境下能坚持,还发面经,感谢!支持!

不客气,我刚开始找工作的时候也从地里得到很多帮助。 :)
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 楼主| lwy1992417 发表于 2015-4-23 08:32:22 | 显示全部楼层
xming0819 发表于 2015-4-23 03:00
C1公司 C2公司 一个是cadence另一个是?

还有一个是Austin 的Cirrus Logic.
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 楼主| lwy1992417 发表于 2015-4-23 08:35:20 | 显示全部楼层
andyhe829 发表于 2015-4-23 03:06
请问mentor graphics楼主面的是什么地方的分部呢?为什么在官网和LinkedIn上看他们都没有什么技术岗位放出 ...

是俄勒冈的。是个Rotation engineer的职位,就是先轮岗一年再分配职位。有可能已经招满了,因为之前他让我两周前去onsite. 然后我告诉他我去不了,他说如果这次招不满再联系我,到现在也没有联系。 Good luck!
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lylchmm 发表于 2015-4-23 12:49:19 | 显示全部楼层
你好,我也准备了这个方向,我想楼主给个联系方式,多交流下好吗?
PS:硬件真是苦逼,但是还要坚守!
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annawuyi 发表于 2015-4-23 13:23:51 | 显示全部楼层
谢谢楼主分享。请问:楼主学什么方向的?这些硬件公司都用C++语言面试吗?硬件有题刷吗?楼主一般怎样搜不熟悉的硬件公司的?谢谢
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 楼主| lwy1992417 发表于 2015-4-24 02:16:33 | 显示全部楼层
lylchmm 发表于 2015-4-23 12:49
你好,我也准备了这个方向,我想楼主给个联系方式,多交流下好吗?
PS:硬件真是苦逼,但是还要坚守!

好的。我的QQ号是360314843 。
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 楼主| lwy1992417 发表于 2015-4-24 02:35:28 | 显示全部楼层
annawuyi 发表于 2015-4-23 13:23
谢谢楼主分享。请问:楼主学什么方向的?这些硬件公司都用C++语言面试吗?硬件有题刷吗?楼主一般怎样搜不 ...

你好。
1.我是ASIC Design/Verification的方向。
2.面试的内容只有一小部分是coding,大部分是概念性的东西和high level 的设计,具体可以参考帖子里面的内容。
3.个人觉得硬件是需要熟悉一下design的题目的,而且基本的编程问题(C++/SV/Verilog)也需要掌握. 下面是我当时准备参考的网站:
http://www.asic-world.com
http://only-vlsi.blogspot.com
http://www.testbench.in
4.关于公司,下面是我申请时候列的一个列表,供参考:Analog devices.鐣欏璁哄潧-涓浜-涓夊垎鍦
Apple. 鐣欏鐢宠璁哄潧-涓浜╀笁鍒嗗湴
Cirrus Logic.鏈枃鍘熷垱鑷1point3acres璁哄潧
Cisco systems
IBM corporation
Intel corporation
Nvidia
Broadcom  
Synopsys
Microsoft
Altera
Mentor Graphics
Qualcomm  
Cadence
Oracle
Western Digital(applied)
Marvell
. Waral 鍗氬鏈夋洿澶氭枃绔,Ericksson
AMD
Sandisk
Google
Juniper
Seagate
Lsi
Xilinx
Arm.鐣欏璁哄潧-涓浜-涓夊垎鍦
Freescale 鏉ユ簮涓浜.涓夊垎鍦拌鍧.
Texas Instruments
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annawuyi 发表于 2015-4-24 18:04:47 | 显示全部楼层
lwy1992417 发表于 2015-4-24 02:35
你好。
1.我是ASIC Design/Verification的方向。
2.面试的内容只有一小部分是coding,大部分是概念性的 ...

谢谢楼主回复。我是学vlsi的。继续请教:1,除了20家全球最大的半导体公司外,楼主是怎么找到一些不熟悉的公司的?这27家公司楼主都投了吗?是内推还是网投的?  2,一般有哪些职位可以投?楼主投了多少公司?回复的公司有几家?现在硬件不会找,楼主一定很牛。3,楼主知道更多的和vlsi相关的网站和公司吗?谢谢
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 楼主| lwy1992417 发表于 2015-4-25 08:10:56 | 显示全部楼层
annawuyi 发表于 2015-4-24 18:04
谢谢楼主回复。我是学vlsi的。继续请教:1,除了20家全球最大的半导体公司外,楼主是怎么找到一些不熟悉的 ...

1.关于相关公司,可以去linkedin上搜索岗位的关键词,也可以和同学学长多交流。我这些公司大部分都网投了。内推了4、5家。
2.关于职位得看你具体的方向,主要分前端(logic design/verification)和后端(physical design, place&route等等)。除了这些还有一些computer architecture的岗位(cache design, cpu verification等等)。我投了20家左右,8、9家给面试。
3.你说的VLSI是layout那些吗?physical design我不是太了解,做前端的大公司我一时半会儿也想不到别的了。
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hjacky 发表于 2015-5-16 13:51:13 | 显示全部楼层
列表很赞!支持LZ一个
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 楼主| lwy1992417 发表于 2015-6-25 07:41:11 | 显示全部楼层
hjacky 发表于 2015-5-16 13:51
列表很赞!支持LZ一个
. 鍥磋鎴戜滑@1point 3 acres
不客气,相互帮助嘛。
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cy422311 发表于 2015-7-22 14:12:18 | 显示全部楼层
楼主能介绍一下背景吗?. Waral 鍗氬鏈夋洿澶氭枃绔,
我网上海投了好多,回复的好少啊
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 楼主| lwy1992417 发表于 2015-7-23 05:12:31 | 显示全部楼层
cy422311 发表于 2015-7-22 14:12. From 1point 3acres bbs
楼主能介绍一下背景吗?
我网上海投了好多,回复的好少啊
-google 1point3acres
背景属于平均水平吧:专排前30的学校的EE master,专业方向ASIC Verification, 主要准备的内容大概就是面经里的那些, GPA 4.0.
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jy02735305 发表于 2015-10-1 10:22:13 | 显示全部楼层
楼主,verification的面试有问UVM、OVM的问题吗?如果了解这些能让面试加分吗?
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jy02735305 发表于 2015-10-1 10:48:01 | 显示全部楼层
还有一个问题,我只会Systemverilog, 没学过C++,也可以申请verification的岗位吗
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