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Preparing ASIC Design Verification Interview

   
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I just finished the job hunting recently for ASIC Design Verification Engineer. Take 6 onsite and get offers from all of them.
Hopefully this should be the last time to prepare for hardware engineer, I am trying to switch to software roles in near future.

Target reader: people with few years of experience / new hire trying to find a job in ASIC Design Verification Engineer.

1. system verilog
    I recommend reading the system verilog LR
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irst/last/next/prev)
       suppose you have an associate array of queue, how to you pass it as function argument? (use typedef)
       array locator( find/find_index/find_first/find_first_with/find_last/find_last_with)
       array reduction(

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 楼主| lapore 2018-7-4 14:00:54 | 只看该作者
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 楼主| lapore 2018-6-27 06:51:48 | 只看该作者
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 楼主| lapore 2018-6-27 06:34:56 | 只看该作者
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 楼主| lapore 2018-6-26 11:41:44 | 只看该作者
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版主为什么点了存草稿就变成审核了

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qzzy 2018-6-27 02:12:29 | 只看该作者
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十分感谢楼主愿意花时间分享成功的准备经验。看起来好像第一部分SV也只成功发布了一部分。会不会是因为篇幅太长,我建议楼主可以考虑分段发表回复。
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 楼主| lapore 2018-6-27 06:01:36 | 只看该作者
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zhuliheng 2018-6-27 06:09:22 | 只看该作者
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非常感谢楼主分享!!
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 楼主| lapore 2018-6-27 06:16:46 | 只看该作者
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chk08 2018-6-29 05:58:25 | 只看该作者
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如果能提供一些 真实面试当中的 题目 思路 就好了 。
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 楼主| lapore 2018-6-29 07:48:58 | 只看该作者
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chk08 发表于 2018-6-29 05:58
如果能提供一些 真实面试当中的 题目 思路 就好了 。

all the code snippet are real interview questions

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