NV DV面经ng版

终于结束了，打破了DV全挂的记录，在此浅浅分享一些我认为面试dv需要具备的技能，希望能给大家提供一些学习的方向，也给自己攒攒人品～

毋庸置疑verilog和system verilog是必须要掌握的语言，不一定精通，但是常用语法bloking/non-blocking, always, initial, 三种fork-join、可综合语句，和一些常考的module比如说sequence detector, edge detector一定要掌握，再难一点的就是fifo, round robin，system verilog重点是OOP方面的内容，我这次没有怎么被问到但是经常会考

对verification的architecture要比较了解，要了解generator, driv

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薄；小绿书是craking什么什么，既有design也有verification的题目，非常全面，但是不建议不学相关知识就直接开刷，那毫无效果。时间不够的话，刷小白书救火；时间充裕的话，刷至少两遍小绿书。网课是udemy的system verilog的前两个part，总时长挺长的但是讲得比较详细，强烈建议跟着part2做项目

目前想到了这么多，欢迎大家继续补充！

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谢谢分享 不过楼主面的是 hardware 或者 chip的DV吧？我下周面一个 system firmware design verification 的职位，感觉内容完全不一样。

laxch123 发表于 2023-7-30 00:36
谢谢分享 不过楼主面的是 hardware 或者 chip的DV吧？我下周面一个 system firmware design verification  ...

嗯嗯嗯是hardware的dv。祝你好运！

laxch123 发表于 2023-7-30 08:36
谢谢分享 不过楼主面的是 hardware 或者 chip的DV吧？我下周面一个 system firmware design verification  ...

请问如果是system的 问题会更偏向什么方面呢

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请问一共有几轮面试啊？

KirinWHIS 发表于 2023-7-30 19:42
请问一共有几轮面试啊？

我是两轮，有人是三轮

楼主是面的SOC ASIC DV还是ASIC DV呢，这两个面试会有什么区别嘛

想问下楼主onsite之前面了几轮呢？是不是当天就知道能不能进下一轮了？谢谢

keoon 发表于 2023-8-10 19:33
想问下楼主onsite之前面了几轮呢？是不是当天就知道能不能进下一轮了？谢谢

总共两轮，一面完第二天就约二面了