楼主: lhjrick
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[我司要招人] Apple SoC组多个opening, 3年左右经验,优秀应届也可

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whswlb 2017-4-3 12:35:15 | 只看该作者
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请问有2017实习机会吗?谢谢
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yyw 2017-4-4 04:33:40 | 只看该作者
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楼主你好,我暂时没有私信权限,没法直接留言。有四年ASIC design 的经验, 熟悉flow and STA. 我的邮箱是whitea7speed@hotmail.com,如果看到希望能邮件联系!非常感谢!
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c89412564 2017-4-6 11:09:09 | 只看该作者
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楼主你好,我暂时没有私信权限,请问还有推荐名额吗?
我2011-2013在北京工作2年,职位是FPGA Engineer,14年来美读硕士,今年夏天毕业,
在这里的research就是VLSI design,设计过SRAM,也流过片,还在packaging实验室做过芯片封装,在这边也一直在做RTL仿真,FPGA实现,有丰富的verilog和VHDL经验。.google  и
我的邮箱:dongliang309@gmail.com ,希望邮件联系!
非常感谢!. 1point 3acres
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 楼主| lhjrick 2017-4-11 02:49:20 | 只看该作者
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whswlb 发表于 2017-4-3 12:35
请问有2017实习机会吗?谢谢

Sorry我们组没有实习openning
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anitaw1118 2017-4-21 05:50:59 | 只看该作者
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你好,权限太低不能私信,希望能被看到。我有verilog经验,做过电路设计,求大神内推~邮箱:yomasawong@gmail.com
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linjie_air 2017-4-28 08:40:03 | 只看该作者
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请问你们组招intern吗? 我现在在SJSU读master,主要是ASICdesign。目前在找intern的机会
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wkx910217 2017-5-4 07:29:20 | 只看该作者
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analog/mixed-signal背景的需要吗?现在在做SerDes system, 期待楼主回复~
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dish_821 2017-6-6 00:45:53 | 只看该作者
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linjie_air 发表于 2017-4-28 08:40
请问你们组招intern吗? 我现在在SJSU读master,主要是ASICdesign。目前在找intern的机会

请问层主找到暑期intern了吗?
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yaqi11111 2017-6-21 09:15:55 | 只看该作者
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楼主您好,我是Tufts EE Master 。有数字电路设计的经验,懂Verilog, 和芯片整体设计流程。可以邮件我您的联系方式吗?我目前无权使用私信功能。感谢!(我的邮箱syq900219@gmail.com
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lyfgerrard 2017-6-21 23:20:24 | 只看该作者
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您好,不知道,现在还内推硬件岗嘛
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