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[EE硬件] VLSI求职3个月感想(进行时)顺便求一波内推!!!

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2018(10-12月)-EE硕士+fresh grad 无实习或全职 | 内推|BayArea湾区 电路/电子/半导体类全职@

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5月份毕业,从东部一个学校,VLSI相关课程只有两门,还是一个兼职老师教的。但是很荣幸收获了伙伴,也是我坚持寻找硬件工作的动力之一。很多面试会问到的课上没学过,都是自己找网站,这里分享几个攒人品:
顺便提一句,目前还在找工作,手上有电面和onsite,就是没有offer。。。头像已经换成锦鲤,尽人事听天命。如果又能够提供机会的哥哥姐姐欢迎联系我,如果有学习/面试资料分享的也欢迎联系,谢谢
邮箱: sihanliu2018@gmail.com ..
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STA:http://www.vlsi-expert.com/
这个网站讲STA很系统,并且用我能听得懂的逻辑,看起来内容很多,我是躺在床上睡不着熬夜无聊看完第一遍的。按照这个讲解会对STA有比较详细的了解,从定义到问题的产生再到解决。

Verilog 刷题:http://hdlbits.01xz.net/wiki/Problem_sets
Verilog最常考的就是sequence detect和fifo的写法,我面试经验不多,这个网站是某校TA编写出来给他们本校学生用的,无意发现,有兴趣的可以看一看

verification:http://www.testbench.in/index.html
这算是我的verification 启蒙网站吧,后来就到硅谷神校上课学习verification和systemverilog了,这个网站就变成检索用的,但是它优点就是不是长篇大论,例子短,可以看看。



补充内容 (2018-10-31 07:17):
没写完就发出去了……

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meolinmeo + 1 很有用的信息!
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 楼主| 大兔子喜欢维尼 2018-12-15 05:21:14 | 只看该作者
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lylchmm 发表于 2018-12-14 14:38
design好于verification。 进了verif的坑一般都会转软的。。。

但是感觉verification的工作内容更需要人力参与吧。我认为verification转码的人多还是因为verification本身对编程要求比design高,更容易转码。而且自己面verification的工作都挂了
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lylchmm 2018-12-15 11:28:49 | 只看该作者
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大兔子喜欢维尼 发表于 2018-12-15 05:21. 1point3acres
但是感觉verification的工作内容更需要人力参与吧。我认为verification转码的人多还是因为verification本 ...

design的future好啊!!
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lylchmm 2018-12-14 14:38:17 | 只看该作者
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大兔子喜欢维尼 发表于 2018-12-11 03:14
嗯嗯是的,感觉verification虽然机会多,但是要求也更高

design好于verification。 进了verif的坑一般都会转软的。。。
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无效楼层,该帖已经被删除
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AshleyL90 2018-11-5 04:27:58 | 只看该作者
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楼主的提供的verilog练习网站好有意思,第一次看到
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jjfcd2 2018-11-22 02:27:20 | 只看该作者
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你不如找asic的试试
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 楼主| 大兔子喜欢维尼 2018-11-24 08:09:56 | 只看该作者
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jjfcd2 发表于 2018-11-22 02:27
你不如找asic的试试

目前主要找RTL design相关的啦。 也会找Design Verification的
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fivefiveabc 2018-12-6 13:44:23 | 只看该作者
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同找硬件工作,可以问下LZ拿下了哪些公司的onsite吗?
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 楼主| 大兔子喜欢维尼 2018-12-8 11:11:32 | 只看该作者
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fivefiveabc 发表于 2018-12-6 13:44 ..
同找硬件工作,可以问下LZ拿下了哪些公司的onsite吗?

拿了两家,一家图像芯片,一家nand flash,都拿到offer
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fivefiveabc 2018-12-8 23:54:46 | 只看该作者
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恭喜楼主请问都是RTL design相关么?
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 楼主| 大兔子喜欢维尼 2018-12-11 03:14:32 | 只看该作者
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fivefiveabc 发表于 2018-12-8 23:54. .и
恭喜楼主请问都是RTL design相关么?

嗯嗯是的,感觉verification虽然机会多,但是要求也更高
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