VLSI DV 面试经历小结

背景：VLSI DV Looking for job on market from 1~4 2020
复习找工作也像做项目一样，前期准备，中期上阵杀敌，后期清理战场。就分这三方面讲讲一点心得，希望给硬件的小伙伴们一点有用的帮助，加油硬件人！

前期：复习资料+寻找机会
复习：
- UVM/SV 这两块是基础，肯定得很熟练。最好再过一遍祖师爷Chris Spear的sv for verification。每次review都有新的体会（大部分是因为第N-1次看的不够仔细哈哈）。UVM看看verification guide/chipverify 这俩就好了。关于config db/phases/seq-driver pattern/TLM ports/factory 滚瓜烂熟就好了。很多公司喜欢问你为什么要用uvm，好处在哪里。会讲就行。那driver/monitor/scoreboard是常见的考试类型，要coding的。
SV最重要的是oop和constraint，还有threads。
- design题目考的占20%，大部分公司有一轮专门是design面（因为dv直接对接design）所以会考你的对verilog/fsm，也有直接写code，比如seq detect，fib num，但是都比较基本，不会特别难。也有circuit design，但是都比较常见，比如mux 设计 nand，3分频的clk。
- Assertion：10%，assert平时不怎么写，所以考起来比较难受，不太熟。
- Leetcode：我只刷了些easy/medium的leetcode，重

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我以为面完了就没事了。但是没想到，还有一关，如何跟hr打交道。感觉跟市场上讨价还价似的，一开始很不习惯，脸皮特别薄，对方一给压力，秒怂。但是慢慢上网查资料，学习怎么跟hr聊pkg，其实这就是一个交互的过程，摸清对方的底牌，给自己设定预期的底牌，照着打就是了。有多个offer最好，这样可以compete。一般口头谈妥以后，一定要让对方发正式offer，这样你掌握了主动权，一般都有一周的时间考虑。有的hr会特别硬气，让你三天就sign，这时候就看你头硬不硬了。哈哈。心态很重要，不能趾高气扬，也不能怂。

找工作历时差不多3个月，感谢那么多帮助过自己的学长/学姐/不认识的人，感觉通过复习面试也提升了自己很多。果然进步就会使人快乐，希望之后再接再厉， 能学到更多东西。 共勉！

04/30/2020

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谢谢楼主分享！正在准备back-end的vlsi面试，看了很多帖子很有用！

楼主棒棒哒 努力是回有回报的
占个楼表态 加油硬件人！

对了。。求大米！！！！（漏了这么重要的一句话。。。。。。。。 = =）

感谢楼主分享，小弟是今年的new grad也是dv方向，看了楼主总结的经验，深有感触因为自己面试也是这样准备的，但是我看好像new grad面试和有工作经验的面试问题都差不多？能不能请楼主分享一下这其中的差别和目前dv的发展前景。谢谢！

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请问lz觉得 newgrad找dv全职时没有相关实习经历会很伤吗...虽然有自己在做uvm项目

h030826 发表于 2020-5-4 10:10
请问lz觉得 newgrad找dv全职时没有相关实习经历会很伤吗...虽然有自己在做uvm项目

不会啊  我当时就没有实习过。。。自学了uvm，也做了一些uvm的项目。。（很简单的fifo uvm tb）。

感谢楼主分享，米已经加了。
现在也在准备dv的面试，但由于积分限制，看不到全部内容，可否通过回复将内容再分享一下，不甚感激。